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Mega STE ohne Steuer PAL/GAL laufen lassen ...

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Lukas Frank:
C301900-002   = PAL16L8  -25ns(VME BUS) (U903)

Cache Rams sind zweimal ST MK48S74-35 (Ebay aus Israel) und zweimal NMOS IMS 1630PL70. Für die letzteren habe ich noch neue 6264-70ns von Kessler.

guest522:
Die SRAMs (U4+U5) sind bei mir IDT 7164S45P
Als TAG-RAMs (U8+U9) sind hier IDT 7164S35P verbaut.

Lukas Frank:
Vielleicht liegt es bei mir auch daran das U903 fehlt, der Sockel ist leer. Der Rechner hängt schon beim umschalten auf 16Mhz.

Arthur:

--- Zitat von: Lukas Frank am Di 07.07.2020, 15:38:12 ---Vielleicht liegt es bei mir auch daran das U903 fehlt, der Sockel ist leer. Der Rechner hängt schon beim umschalten auf 16Mhz.

--- Ende Zitat ---

There is a register implemented in the SCU used to select processor speed (8/16 MHz) and enable cache memory. The address decode for the register is done by PAL UA02 (Pg. 10). Bit 0 enables the cache and bit 1 selects the processor speed. The clock control signal is generated by PAL U407 (Pg. 4) and supplied to PAL U11 (Pg. 1). The cache enable signal is also supplied to PAL Ull. These signals are the multiplexed to the processor clock pin and cache enable pins of the SRAM by PAL U12 (Pg. 1).
2.2.7
68901

Arthur:
The VME bus is provided for system expansion. The bus is composed of 23 address
lines and 16 data lines. Control for the bus is provided by PAL U903 (Pg. 9) and U904
(Pg. 9). External interrupt requests to the VME bus are handled by the SCU IC U801
(Pg. 8 ).

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